Diferencia entre revisiones de «Translation Lookaside Buffer»
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{{referencias}}'''Translation Lookaside Buffer''' (TLB) es una memoria [[caché]] administrada por la [[MMU]], que contiene partes de la [[tabla de
== Funcionamiento ==
El TLB hace referencia a direcciones físicas en su tabla. Puede residir entre la CPU y la [[caché]] de la misma o entre esta caché y la unidad de [[memoria primaria]]. Esto depende de si la caché utiliza direccionamiento físico o virtual. Si la caché se
Una optimización común para las cachés direccionadas de manera física es realizar una búsqueda en el TLB en paralelo con el acceso a caché. Los bits de orden más bajo de cualquier dirección virtual (por ejemplo en un sistema de [[memoria virtual]] que tiene páginas de 4KB, los 12 bits más bajos de la dirección virtual) no cambian en la traducción de dirección virtual a física. Durante un acceso a caché se realizan dos acciones: Se utiliza un índice para encontrar una entrada en el sistema de datos de la caché, y a continuación las etiquetas de la línea encontrada se comparan. Si la caché está estructurada de tal manera que pueda ser indexada utilizando solo los bits que no cambian en la traducción, la caché puede realizar su operación de "indexación" mientras el TLB traduce la parte alta de la dirección. Entonces, la dirección traducida del TLB es enviada a la caché. La caché realiza una comparación de etiquetas para determinar si este acceso ha sido un acierto o un fallo.
=== Fallo ===
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:Ratio de fallos: 0.01% - 1%
Si un acierto de TLB requiere 1 ciclo de reloj, un fallo requiere 30 ciclos, y siendo el ratio de fallos 1%, el ratio de ciclos de memoria efectiva es una media de <math>1 \times 0,99 + (1 + 30) \times 0,01 = 1,30</math> ciclos de reloj por acceso a memoria.
Si un ía:Unidad central de procesamiento]]▼
== Véase también ==
* [[Unidad de manejo de memoria]]
[[Categoría:Memorias informáticas]]
[[cs:Translation Lookaside Buffer]]
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